FPGA/CPLD最新实用技术指南|杨恒|清华大学出版社

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FPGA/CPLD最新实用技术指南

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作者：杨恒	出版社：清华大学出版社
译者：	丛书名：
出版日期：2005-1-1	上架日期：2005-10-27 16:20:00
ISBN：7302101639	页数：版次：初版
开本：16开	装帧：平装

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| 大封面 | 封底 | 前言 | 内容简介 | 序言 | 目录 | 作者简介 | 译者简介 | 作者序 | 译者序 |

【读者评论】

内容简介

fpga/cpld技术是近年来计算机与电子技术领域的又一场革命。本书以xilinx与altera公司的fpga/cpld为主，详细介绍了fpga/cpld从芯片到max+plusⅱ、quartus与ise开发环境和verilog/vhdl语言，并以交通灯逻辑控制、电子钟与点阵led显示、lcd液晶显示及计算机isa接口和pci接口的设计等为例，由浅入深地详述了如何应用fpga/cpld进行电子设计。书中的大多数电路图和源程序已经过实例验证，读者可以直接应用于自己的设计。本书的特点是强调实用性和先进性，力求通俗易懂。
本书适用于计算机、电子、控制及信息等相关专业的在校大学生，对广大工程技术人员也具有实用价值。

目录
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016004-01.txt 
 
  目  录
第0章  绪论	1
0.1  fpga/cpld概述	1
0.2  fpga/cpld的开发软件	2
0.3  fpga/cpld的分类和使用	3
0.4  因特网上的fpga及其他资源	4
0.5  本章小结	5
第1章  xilinx cpld系列产品	6
1.1  简介	6
1.1.1  xc9500系列cpld器件	6
1.1.2  coolrunner 系列cpld器件	9
1.2  xc9500系列器件的结构	11
1.3  coolrunner系列cpld器件的结构	19
1.4  xilinx cpld器件的命名	22
1.5  本章小结	23
第2章  xilinx fpga系列产品	24
2.1  spartan-ii e系列产品	24
2.1.1  概述	24
2.1.2  器件结构	25
2.2  spartan-3系列产品	29
2.2.1  概述	29
2.2.2  器件结构	29
2.3  virtex-ⅱ系列产品	33
2.3.1  概述	33
2.3.2  器件结构	34
2.4  virtex-ⅱpro系列产品	40
2.4.1  概述	40
2.4.2  器件结构	40
2.5  virtex-4系列产品	45
2.5.1  概述	45
2.5.2  virtex-4系列的总体结构	46
2.5.3  virtex-4的三个平台fpga简介	47
2.5.4  virtex-4 fpga综述	48
2.6  本章小结	48
第3章  cpld/fpga的边界扫描测试	49
3.1  引言	49
3.2  ieee 1149.1边界扫描测试的结构	49
3.3  jtag bst操作控制	51
3.3.1  抽样/预加载（sample/preload）指令模式	54
3.3.2  外测试（extest）指令模式	55
3.3.3  旁路（bypass）指令模式	56
3.3.4  用户码（usrcode）指令模式	57
3.3.5  id码（idcode）指令模式	57
3.4  xilinx器件的边界扫描	58
3.4.1  数据存储器（data register）	58
3.4.2  指令集（instruction set）	58
3.4.3  位顺序（bit sequence）	59
3.4.4  在设计中插入边界扫描	59
3.5  边界扫描描述语言（bsdl）	62
3.6  xilinx器件下载	62
3.6.1  multilinx下载电缆	63
3.6.2  xchecker下载电缆	63
3.6.3  parallel下载电缆	63
3.7  altera与lattice公司cpld下载电路	66
3.8  本章小结	68
第4章  xilinx ise应用基础	69
4.1  xilinx ise简介	69
4.2  安装xilinx ise	70
4.2.1  系统需求	70
4.2.2  ise的安装	70
4.3  xilinx ise应用入门	76
4.4  xilinx ise设计流程	80
4.4.1  设计输入	81
4.4.2  功能仿真	83
4.4.3  综合	84
4.4.4  实现	84
4.4.5  时序仿真	85
4.4.6  下载配置	85
4.5  设计实例	85
4.6  本章小结	90
第5章  xilinx ise高级应用	91
5.1  设计输入	91
5.1.1  硬件描述语言（hdl）输入方式	91
5.1.2  原理图（schematic）输入方式	98
5.2  功能仿真和时序仿真	100
5.2.1  功能仿真	100
5.2.2  时序仿真（对顶层文件进行仿真）	106
5.3  设计实现	106
5.3.1  运行实现设计	106
5.3.2  在布局规划器（floorplanner）中查看设计布局	107
5.4  引脚锁定与器件下载编程	109
5.4.1  引脚锁定	109
5.4.2 cpld器件的编程下载	110
5.5  应用ise 6.2i的矩阵led设计实例	110
5.5.1  功能要求及硬件设计	110
5.5.2  控制逻辑设计	111
5.5.3  在ise 6.2i中建立矩阵led的工程文件并下载到cpld运行	115
5.6  本章小结	121
第6章  max+plus ii 10.1的使用指南	123
6.1  max+plus ii 10.1的特点	123
6.2  max+plus ii的组成	123
6.3  max+plus ii的使用	124
6.3.1  图形文件的建立	125
6.3.2  文本文件的建立	128
6.3.3  建立顶层设计文件	128
6.3.4  工程文件的编译	129
6.3.5  模拟仿真	131
6.3.6  定时分析	133
6.3.7  器件编程	135
6.4  本章小结	138
第7章  quartus ii使用指南	139
7.1  quartus ii设计入门	139
7.1.1  简介	139
7.1.2  设计流程	140
7.1.3  设计入门	152
7.1.4  综合	163
7.1.5  仿真	169
7.1.6  布线与制板	176
7.1.7  块结构设计	184
7.1.8  对eda工具使用logiclock	190
7.2  延时分析与延时终止	190
7.2.1  在quartusⅱ软件中执行延时分析	190
7.2.2  使用eda工具执行延时分析	194
7.2.3  延时终止	195
7.3  工程设计、调试与修改管理	199
7.3.1  使用signaltap逻辑分析器	200
7.3.2  使用信号探针（signalprobe）	202
7.3.3  使用芯片编辑器	205
7.3.4  工程管理简介	205
7.4  系统设计	209
7.4.1  用sopc builder创建sopc设计	210
7.4.2  用dsp builder创建dsp设计	212
7.5  软件开发	213
7.6  下载与配置	221
7.7  本章小结	228
第8章  flex 6000系列器件简介及应用实例	229
8.1  flex 6000系列器件简介	229
8.1.1  特点	229
8.1.2  概述	230
8.1.3  功能描述	231
8.1.4  输出配置	241
8.1.5  jtag边界扫描	241
8.2  交通信号灯控制逻辑设计	242
8.2.1  系统要求分析	242
8.2.2  控制逻辑描述	242
8.3  电子钟的设计实例	244
8.3.1  功能要求和结构	244
8.3.2  控制芯片的设计	245
8.4  字符型lcd（ks0066）接口的设计	254
8.4.1  原理介绍	254
8.4.2  字符型lcd（ks0066）接口的vhdl描述	263
8.5  本章小结	269
第9章  flex 10k嵌入式可编程逻辑系列器件简介及应用实例	270
9.1  flex 10k嵌入式可编程逻辑系列器件简介	270
9.1.1  特点	270
9.1.2  总体描述	273
9.1.3  功能描述	274
9.1.4  相同结构的输出引脚	292
9.1.5  时钟锁和时钟推进特性	292
9.1.6  输出设置	293
9.1.7  jtag边界扫描	295
9.1.8  配置和操作	297
9.2  应用flex 10k设计图像点阵型lcd	298
9.2.1  图像点阵型lcd原理介绍	298
9.2.2  基于flex 10k的图像点阵型lcd控制设计	302
9.3  本章小结	312
第10章  应用fpga设计pc机的isa和pci总线接口	313
10.1  应用fpga设计pc机的isa总线接口	313
10.1.1  isa总线概述	313
10.1.2  基于altera flex6000的isa接口设计	316
10.2  应用fpga设计pc机的pci总线接口	323
10.2.1  pci总线概述	323
10.2.2  pci总线命令	327
10.2.3  pci总线访问地址解码	328
10.2.4  pci配置空间操作	328
10.2.5  基于altera公司的flex10k系列fpga实现的pci接口设计	331
10.3  本章小结	347
附录a  altera公司fpga/cpld 系列器件纵览	348
附录b  vhdl编程基础	367
附录c  verilog hdl编程基础	412
附录d  max+plus ii windows 2000 驱动配置指南	426
附录e  max+plus ii windows xp 驱动配置指南	428
附录f  ise 6.1i的新增功能	431
附录g  fpga/cpld快速学习开发工具chicago 6.0	435
附录h  fpga/cpld万能型快速学习开发器chicago 8.0	439
参考文献	440

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