TMS320C28x系列DSP的CPU与外设(上)|张卫宁|清华大学出版社

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TMS320C28x系列DSP的CPU与外设(上)

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作者：张卫宁	出版社：清华大学出版社
译者：	丛书名：
出版日期：2004-9-1	上架日期：2005-11-3 12:54:00
ISBN：7302085927	页数：版次：初版
开本：16开	装帧：平装

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| 大封面 | 封底 | 前言 | 内容简介 | 序言 | 目录 | 作者简介 | 译者简介 | 作者序 | 译者序 |

【读者评论】

内容简介
本书详细介绍了TMS320C28x系列数字信号处理器（DSP）的总体结构、CPU内核和存储器映像，并介绍了C28x的寻址方式及汇编语言、时钟和系统控制、片内外设的中断扩展和引导ROM、仿真特性等。
本书可供高等学校电子、通信、计算机、自动控制和电力电子技术等专业高年级本科生及研究生作为教科书或参考书，也可作为各领域中从事信号处理、控制和电力电子技术的科研及工程技术人员的参考书籍。

目录
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第1章芯片结构及性能概述	1
1.1TMS320C28x系列芯片的结构及性能	1
1.2引脚分布及引脚功能	5
第2章中央处理单元CPU	17
2.1CPU概述	17
2.1.1同其他TMS320C2000CPUs的兼容性	17
2.1.2CPU的组成	18
2.1.3CPU的主要特性	19
2.1.4仿真逻辑	19
2.1.5CPU的信号	19
2.2CPU的结构及总线	20
2.2.1CPU结构	20
2.2.2地址和数据总线	21
2.3CPU的寄存器阵列	22
2.3.1累加器（ACC、AH、AL）	24
2.3.2被乘数寄存器（XT）	25
2.3.3结果寄存器（P、PH、PL）	25
2.3.4数据页指针（DP）	26
2.3.5堆栈指针（SP）	26
2.3.6辅助寄存器（XAR0~XAR7、AR0~AR7）	27
2.3.7程序计数器（PC）	28
2.3.8返回程序寄存器（RPC）	28
2.3.9中断控制寄存器（IFR、IER、DBGIER）	28
2.3.10状态寄存器（ST0）	29
2.3.11状态寄存器（ST1）	41
2.4程序流	45
2.4.1中断	45
2.4.2分支、调用及返回	45
2.4.3单个指令的重复执行	46
2.4.4指令流水线	46
2.5乘法操作	46
2.5.116位×16位的乘法	46
2.5.232位×32位的乘法	47
2.6移位操作	48
第3章CPU的中断系统和复位	53
3.1CPU中断概述	53
3.2CPU中断向量和优先级	54
3.3可屏蔽中断	55
3.3.1中断标志寄存器（IFR）	56
3.3.2中断使能寄存器（IER）和调试中断使能寄存器（DBGIER）	57
3.3.3可屏蔽中断的标准操作	58
3.4非屏蔽中断	62
3.4.1INTR指令	62
3.4.2TRAP指令	62
3.4.3非屏蔽硬件中断	64
3.5非法指令陷阱	65
3.6硬件复位	65
第4章流水线	67
4.1指令流水线	67
4.1.1减弱流水线段	68
4.1.2取指令机制	68
4.1.3地址计数器FC、IC和PC	69
4.2可视流水线操作	70
4.3流水线活动的冻结	72
4.3.1等待状态	72
4.3.2指令无用状态	72
4.4流水线的保护	73
4.4.1对同一数据空间进行读写时的保护	73
4.4.2保护寄存器冲突	74
4.5非保护流水线冲突的避免	76
4.5.1非保护的程序空间读和写	76
4.5.2对影响另一存储单元的单元进行读写	76
4.5.3写操作后的读保护模式	77
第5章存储器映像	79
5.1片内程序/数据存储器[1][2]	79
5.2片内Flash和OTP存储器	85
5.2.1Flash存储器和OTP存储器	85
5.2.2Flash和OTP存储器的电源模式	86
5.2.3Flash流水线模式	88
5.2.4Flash和OTP的寄存器	88
5.3代码安全模块（CSM）	92
5.3.1功能说明	92
5.3.2CSM对其他片内资源的影响	93
5.3.3用户应用程序中的合并代码安全性	94
5.3.4保护安全逻辑要做的和不要做的（DosandDon’ts）	97
5.3.5CSM特点总结	97
5.4片外存储器及外部接口XINTF	97
5.4.1功能说明	98
5.4.2XINTF配置综述	99
5.4.3建立、激活及跟踪状态的配置	102
5.4.4XINTF寄存器	105
5.4.5信号说明	114
5.4.6波形	115
5.4.7外部DMA支持（、）	118
5.5各存储器映像区域的等待状态[1]	119
第6章C28x的寻址方式及汇编语言简介	121
6.1寻址方式	121
6.2寻址方式选择位（AMODE）	122
6.3汇编器/编译器对AMODE位的跟踪	124
6.4直接寻址方式（DP）	125
6.5堆栈寻址方式（SP）	126
6.6间接寻址方式	127
6.6.1C28x的间接寻址方式（XAR0～XAR7）	127
6.6.2C2xLP的间接寻址方式（ARP、XAR0～XAR7）	129
6.6.3循环间接寻址方式（XAR6、XAR1））	139
6.7寄存器寻址方式	141
6.7.132位寄存器寻址方式	141
6.7.216位寄存器寻址方式	142
6.8数据/程序/IO空间立即寻址方式	144
6.9程序空间间接寻址方式	145
6.10字节寻址方式	147
6.1132位操作的定位	148
6.12C28x汇编语言简介	148
第7章时钟和系统控制	159
7.1时钟和系统控制	159
7.2振荡器OSC和锁相环PLL时钟模块	163
7.2.1基于PLL的时钟模块	163
7.2.2外部参考振荡器时钟选择	165
7.3低功耗方式模块	165
7.4看门狗模块	167
7.4.1有关寄存器	168
7.4.2仿真需要考虑的事项	170
第8章片内外设的中断扩展（PIE）	171
8.1PIE控制器概述	171
8.2向量表映像	173
8.3中断源	175
8.3.1多通道中断处理过程	176
8.3.2使能和禁止多通道外设中断	177
8.3.3从外设到CPU的多通道中断请求流程	178
8.3.4PIE向量表	179
8.4PIE配置寄存器	184
8.5PIE中断寄存器	185
8.6外部中断控制寄存器	193
第9章引导ROM及引导装载器功能	197
9.1引导ROM概述	197
9.1.1在引导ROM中XMPNMC的作用	197
9.1.2片内ROM介绍	198
9.2引导ROM版本和求和校验信息	199
9.3CPU向量表	200
9.4引导装载器（Bootloader）特性	201
9.4.1Bootloader操作过程	201
9.4.2Bootloader设置	203
9.4.3Bootloader模式	204
9.4.4Bootloader数据流结构	206
9.4.58位模式源程序数据流的通用结构	208
9.4.6基本的数据传输过程	211
9.4.7初始化引导汇编程序（InitBoot）	212
9.4.8引导模式选择函数（SelectBootMode）	213
9.4.9SCI引导函数（SCI_Boot）	214
9.4.10并行引导函数（Parallel_Boot）	216
9.4.11SPI引导函数（SPI_Boot）	219
9.4.12退出引导汇编程序（ExitBoot）	222
9.5建立引导表	223
9.6Bootloader代码列表	224
第10章仿真特性	252
10.1仿真特性概括	252
10.2调试接口	252
10.3调试术语	254
10.4控制方式	255
10.4.1停止方式	255
10.4.2实时方式	256
10.4.3停止方式和实时方式总结	258
10.5异常中断和ABORTI指令	259
10.6DT-DMA机制	259
10.7分析断点、观察点和计数器	261
10.7.1分析断点	261
10.7.2观察点	262
10.7.3基准计数器/事件计数器	263
10.7.4典型的分析单元结构	263
10.8数据记录（DataLogging）	264
10.8.1产生数据记录传送缓冲器	264
10.8.2正确访问仿真寄存器	267
10.8.3数据记录中断（DLOGINT）	268
10.8.4数据记录举例	268
10.9共享分析资源	270
10.10诊断和恢复	271

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