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内容简介
除讲述基本的设计技巧外,还深入介绍了多模块整合设计技术,适合各层次设计者参考使用。内容包括:数字逻辑设计与verilog发展历史,veril og设计风格与概念,verilog设计结构,门级描述,数据流建模,行为描述,函数及任务,udp逻辑电路与状态机,verilog程序设计技巧,电路延时时序的设定及实用专题设计范例等。 本书适于大专院校电子类及计算机工程类本科及研究生,以及相关领域的工程设计人员使用。
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